数字逻辑与数字系统设计-基于Proteus VSM和Verilog HDL(高等院校信息技术规划教材)

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  • 版 次:1
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  • 印刷时间:2013年08月01日
  • 开 本:大32开
  • 纸 张:胶版纸
  • 包 装:平装
  • 是否套装:否
  • 国际标准书号ISBN:9787302328780
  • 丛书名:高等院校信息技术规划教材
作者:卢建华 等编著出版社:清华大学出版社出版时间:2013年08月 
内容简介

  本书比较全面地介绍了数字电路的基本概念和工作原理,并以Proteus ISIS为辅助工具,用可视化方式实现数字逻辑电路的分析和设计,有利于加深读者对数字逻辑电路和数字系统设计的理解和掌握。与此同时,通过大量实例将目前数字系统设计中常用的Verilog硬件描述语言引入数字逻辑电路的设计过程中,使读者尽可能早地接触到新的设计方法,不仅为本课程的教学开拓新路,同时也为将此类方法用于后续课程的学习打下良好基础。本书内容包括基础知识、逻辑代数基础、逻辑门电路、组合逻辑基础、组合逻辑电路、时序逻辑基础、时序逻辑电路、脉冲数字电路、转换电路、可编程逻辑基础、数字系统设计基础等。
  本书可作为计算机类、电子类、自动化类等相关专业的本科生教材或教学参考书,也可供相关专业的工程技术人员参考。

目  录
第1章 基础知识
1.1概述
1.1.1数字信号与模拟信号
1.1.2数字系统的基本结构
1.2常用数制及其转换
1.2.1十进制
1.2.2二进制
1.2.3二进制与十进制之间的相互转换
1.2.4八进制数和十六进制数及其与二进制数之间的转换
1.2.5八进制在数制转换中的桥梁作用
1.2.6不同数制数据的后缀表示
1.3带符号二进制数的表示方法
1.3.1原码
1.3.2反码

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